Custom Compilerデータシート

Datasheet
Custom Compiler
ビジュアル・アシスト機能による設計自動化
概要
Custom Compiler は、FinFET カスタム・デザインの各工程にかかる期間を数日単位
Custom Compiler™ は、一般的な
者に提供することにより、複雑なコーディングや設計制約定義を行う手間を省き、設計
設計タスクをスピードアップし、イタレー
ションを削減し、設計資産の再利用を
可能にする独自のビジュアル・アシスト
機能による設計自動化フローを搭載し
たフルカスタム設計ソリューションです。
から数時間単位に短縮します。なじみ易いグラフィカルなユースモデルをレイアウト設計
生産性を向上させます。設計者は、特段のセットアップ作業をすることなく、繰り返し
発生するルーチン・タスクを自動処理することができます。Custom Compiler のビジュ
アル・アシスト機能による設計自動化フローでは、Layout、In-Design、Template、
Co-Design の 4 つの“Assistants”機能を提供します。
FinFET ベースのアナログ・ミックスド
シグナル回路のインプリメントを短時間
で可能にする機能を搭載しているため、
Co-Design
Assistants
に最適です。
IC Compiler I & II
困難な設計課題を伴う最先端デザイン
Layout
Assistants
Template
Assistants
Digital
P&R
Place
Create
Custom
Edits
Route
Find &
Realize
DRC
EM/IR
RCx
In-Design Assistants
図1：Custom Compiler のビジュアル・アシスト機能による設計自動化フロー
Custom Compiler Assistants
▶ Layout Assistants
ビジュアルなガイド機能に従って配置配線を自動化することにより、レイアウトにかかる時間を短縮します。
配置エンジンは、新しい革新的な手法を用いて配置を実行し複数の配置パターンを設計者に提示、設計者はそれを元に配置の
精緻化を進めることができます。そのため、制約条件を前もって入力しておく手間をかけることなく最適なレイアウト結果を作成
することができます。
配線エンジンは、FinFET アレイや大規模な M ファクター（繰り返し配列）トランジスタの配線を効率的に実行できます。設計者は、
配線画面でマウスを使って配線エンジンにシンプルに配線意図を指示するだけで、あとは配線エンジンが自動的に詳細な配線を
実行、同じパターンの配線の複製やピンへの引き込み配線を自動生成します。
図 2 は、互いにかみあうように配置されたディファレンシャル・ペア・トランジスタを自動配線する例を示しています。黄色のフライ
ラインが配線の開始点と現在のカーソル位置を示しています。マウスで大まかに配線を入力すると、入力された配線と各トランジスタ
のピンが自動的に接続されます。この例ではトランジスタは繰り返し配列状に配置されています。配線エンジンは、その繰り返し
配置構造を認識して、一部の配線経路を指示するだけで対応する他の部分にも同じ配線を生成します（自動配線クローニング）。
図2：自動配線クローニングとピン配線しながらのインタラクティブ配線
▶ In-Design Assistants
物理的・電気的なエラーをサインオフ検証以前の段階で把握することにより、開発コスト要因となるイタレーションを削減でき
ます。Custom Compiler には、非常に高速なデザイン・ルール・チェック（DRC）エンジンが組み込まれており、あらゆる工程で
DRC を実行しつつ設計を進めることができます。さらに、エレクトロマイグレーション・チェック ( 図 3 を参照 ) や寄生容量抽出も
Custom Compiler 環境下でネイティブ実行できます。一般に“電気的な効果を考慮する”と主張するツールとは異なり、Custom
Compiler は、業界のゴールデン・スタンダード・ツールであるシノプシスの StarRC™の抽出エンジンを使用しています。
図3：エレクトロマイグレーション・チェック
2
Custom Compiler ビジュアル・アシスト機能による設計自動化
▶ Template Assistants
シンプルな操作で、既存のレイアウト・パターンを新しいデザインに適用できるため、蓄積した過去の設計ノウハウの再利用が
容易になります。Template Assistants は、それ以前に Custom Compiler の配置・配線エンジンが生成したレイアウトを学習し、
過去にレイアウトを完了したものに類似する回路をインテリジェントに認識します。設計者は、そのときのレイアウト結果をテンプ
レートして使用し、新しいデザインに過去と同種の配置配線パターンを効率的に適用できるようになります。例えば Custom
Compiler のシンボリック・エディターなどには、カレント・ミラー、レベル・シフタ、ディファレンシャル・ペアをはじめとする、よく
使われる回路のレイアウトパターンがライブラリとして組み込まれています。
図4：ディファレンシャル・ペアのレイアウト・パターン例
▶ Co-Design Assistants
カスタム回路とデジタル回路の混在デザインに対しては、IC Compiler™と Custom Compiler を、統合された設計ソリューション
として使用することができます。設計者は、IC Compiler と Custom Compiler それぞれのコマンドを使用して両ツール間を自由に
行き来し、デザインを仕上げていくことができるようになります。IC Compiler ユーザーは、所望の設計段階で、図 5 に示すように
デジタル・デザインにフル・カスタム・エディットを組み込むことができ、同様に、Custom Compiler ユーザーは、IC Compiler が
生成したデジタル・ブロックをカスタム・デザインの中に取り込むことができます。両ツール環境間を制約無く行き来できるため、
設計工程でデザイン上に生じたあらゆる変更点は、デジタル・デザイン・データベースとカスタム・デザイン・データベースの双方で
同期を取って共有されます。
図5：IC Compilerによる設計段階でのフル・カスタム・エディット
Custom Compiler ビジュアル・アシスト機能による設計自動化
3
Custom Compiler は、豊富な機能を持つスケマティック・エントリー環境と、大量のシミュレーション・データを処理できるシミュレー
ション環境を提供しており、非常に効率の高い高速レイアウト・エディット作業と、堅牢な FinFET デザインとなっているかどうかの
確認作業の両方を、このオープンな環境上で実行できます。Custom Compiler には、HSPICE®, FineSim® and CustomSim™
のシミュレーション / 解析環境をネイティブに統合することができます。
Custom Compiler
スケマティック・エディット/
解析環境
HSPICE, FineSim,
CustomSim
Custom WaveView
Custom Compiler
レイアウト
図6：シミュレーション/解析環境
アナログ検証のためのパワフルなインターフェイスとなる GUI ベースの検証環境を提供します。この検証環境の機能には、
HSPICE、FineSim、CustomSim を用いた高度な解析、マルチテストベンチ、マルチコーナー、モンテカルロ・シミュレーション
といったシミュレーション実行のセットアップ、シミュレーション・ジョブの分散実行と進行状況のモニター機能などがあります。
Custom Compiler は、業界標準の設計データベース Open Access をベースにしており、直感的に操作できるメニュー構造を
提供しているため、レイアウト経験のある設計者なら短期間で習熟できます。スケマティック・エントリーからシミュレーション解析、
レイアウトにいたるまでオープンな設計環境を提供します。また、シノプシスのカスタム・シミュレーション・ツール、フィジカル検証
ツール、デジタル設計ツールとも統合されているため、包括的なカスタム設計環境を提供することができます。
Custom Compiler は、多くの独自機能を提供するだけでなく、カスタマイズ性も高いため、複雑な FinFET デザイン構造のレイア
ウトを容易に実行できます。設計者の生産性とスループットの向上を主眼に置いて開発しており、各種の独自の自動化機能を組み
合わせてご活用いただける一方で、開発対象の回路に合わせて使いこなすことができるようになっています。この柔軟性と
カスタマイズ性を最大限高めるため、TCL、Python、C++ をサポートしており、これらを組み合わせて用いることも自在です。また、
iPDK 標準もサポートしており、ファウンダリ各社から幅広い Custom Compiler デザインキットが提供されています。
Custom Compiler の詳細は、www.customcompiler.info をご覧ください。
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03/29/16.TT_CS7112_CustomCompiler_DS_6.

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